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Arquitetura do conjunto de instruções – CISC e RISC

 

  • Arquitetura do conjunto de instruções
    • Arquitetura CISC (Complex Instruction Set Computer)
      • instruções interpretadas por meio de microcódigo interno ao processador;
      • muitas instruções, de tamanho variável e com formato e decodificação complexos (vários ciclos p/ execução de uma instrução);
      • instruções do tipo registrador-memória (resultado armazenado em memória pela instrução);
      • acesso à memória por qualquer instrução e com muitos modos de endereçamento;
      • poucos registradores, com mais acessos à memória e menor eficiência;
      • não utiliza ou faz pouco uso de pipelining;
      • compilador mais simples em que a tradução da linguagem de alto nível resulta em menos código (devido as instruções complexas);
      • hardware mais complexo com frequências mais baixas;
    • Arquitetura RISC (Reduced Instruction Set Computer)
      • instruções executadas diretamente pelo circuito do processador (hardwired), sem interpretação por microcódigo;
      • poucas instruções, de tamanho fixo e com formato e decodificação simples (executa uma instrução por ciclo);
      • instruções do tipo registrador-registrador (resultado em registrador para armazenamento em memória por store);
      • acesso à memória somente por load e store e com endereçamento por registrador;
      • muitos de registradores, inclusive para operandos;
      • projetada para a utilização de pipeline;
      • compilador mais complexo em que a tradução da linguagem de alto nível resulta em mais código (devido as instruções simples);
      • hardware mais simples com frequências mais altas;
    • Arquitetura híbrida
      • instruções comuns são executadas diretamente por hardware (em um único ciclo do caminho de dados);
      • instruções complexas são interpretadas por meio de microcódigo;

 

 

 

 

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